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达摩院-CPU/AI 系统架构与建模工程师 / 架构师-RISC-V及生态
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职位描述
岗位介绍：从系统全局及端到端性能视角，参与 CPU、AI 及异构计算 SoC 的架构定义与优化。通过性能建模、真实工作负载分析和性能验证，识别系统瓶颈、探索新架构，并为芯片性能、能效及资源配置提供量化决策依据。 工作职责： 1.性能模型开发：根据架构研究和项目需求，从零设计、搭建和维护 CPU、AI 加速器及 SoC 子系统的性能模型，包括高层次性能模型（High-Level Performance Model）和周期精确的电子系统级仿真模型（Cycle-Accurate ESL Model）。合理确定模型边界、抽象层次和时序精度，兼顾仿真效率与预测准确性。 2.架构探索与性能预测：利用模型开展设计空间探索（Design Space Exploration）和 What-If Analysis，评估不同架构、微架构及资源配置方案。分析计算、存储、互连和 I/O 之间的性能制约关系，预测新方案的性能收益，并综合考虑功耗、面积和实现复杂度，提出可落地的优化建议。 3.真实工作负载分析：深入分析服务器、AI 训练与推理等应用的关键 Workload，理解其计算特征、访存行为、数据流和并行性。
任职要求
1.至少 3 年相关工作经验，从事过 CPU、AI 加速器或 SoC 架构设计、性能建模或性能分析。完整参与并完成过至少 1 个芯片或相关子系统项目，在其中承担明确的架构或性能建模职责，具备从方案评估、模型开发到性能验证的实际经验。 2.具备从零搭建性能模型的能力，能够独立完成需求分析、模型划分、接口定义、关键行为及时间建模、调试与验证。既能开发用于系统分析和快速方案评估的 High-Level Performance Model，也能开发关键模块或子系统的 Cycle-Accurate ESL Model。 3.熟练使用 C/C++，具备 SystemC 或其他事件驱动、周期驱动仿真框架的开发经验；能够使用 Python 等工具进行 Workload 处理、仿真自动化、数据分析和结果可视化。 4.具备扎实的 CPU、AI 加速器及 SoC 基本 IP 架构知识，并在其中至少一个方向具有深入实践： 1）CPU 微架构、Cache、预取、内存一致性及内存子系统； 2）AI 计算单元、数据流、片上存储、DMA 及计算与数据搬运的协同； 3）NoC、DDR/HBM 控制器、PCIe、片间互连